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TI
CPU的效率
2019-07-18 15:32
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TI MCU
4557
9
1077
比如说FIFO默认的1/2满，接收中断触发，此时触发的中断是不是说接收的数据还没有全部接收完毕，只是收了4位，这样程序还要一直等待数据接收完毕。如果是这样的话，接收中断就占用了大量的程序时间，CPU的效率实在是太低了啊。
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9条回答
jiajs
2019-07-19 04:28
FIFO是为了节省CPU时间的，设置为1/2满，此时，在收到4个以上字节（不是位）时会产生中断，此时需要您把数据及时取走，因为FIFO只有8个字节，超过8个字节不取走，就会丢失数据。
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