2020-02-20 20:45发布
rootxie 发表于 2014-9-8 21:20 DDR部分设计 如果贵司采用cadence就直接拷贝 freescale demo板走线,省了不少事了,我司就这么干的 叠层 ...
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我们用的PADS,主要看一下走线方式,以及一些走线特点。照搬估计不太现实。
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