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高速时钟分配电路及布线对电源分割的影响，

2019-07-16 21:49发布

站内问答 / Altium Designer
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什么是“立体包地”？

板子上有一片时钟分配芯片，即100Mhz时钟输入，输出20多路相同频率的时钟。该时钟芯片摆在底层，时钟走线也布在底层，最靠近底层的内层是一个电源层，分割了不同电源，如下图所示，调试的时候发现紫 {MOD}分块的电源被耦合了100Mhz的交流分量，幅度大概在150mV左右。: y: K# v# T* L2 L
请问有什么补救的措施吗？是不是倒数第二层分配成地层不会有这个问题啊？



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19条回答
胖子的逆袭
2019-07-17 07:38
麦特拉布 发表于 2014-10-24 11:40
1：加滤波电容
2：做信号端接

100M大概用多大的电容滤波，上过一个1nf的，没什么作用。
时钟分配器的输出都穿有电阻做端接，你所谓的“平面分割“是什么意思？我的问题就是这一大把时钟走线对相邻平面（紫 {MOD}）分割产生上述”耦合“影响。

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