task_stuct 进程
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kangerdong
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- 2019-07-14 09:52
进程是一个正在执行的程序，是程序的一个实例，它能分配处理器并由处理器执行的实体。一个除处理器其他元素都具备的程序也叫做进程，简单来说就是一个动态的执行过程。
PCB就是一个名字叫做task_struct的结构体,我们叫他进程描述符。...
大电容滤低频，小电容滤高频？—滤波电容的选择
一直有个疑惑：电容感抗是1/jwc,大电容c大,高频时w也大,阻抗应该很小,不是更适合滤除高频信号？然而事实却是：大电容滤除低频信号。
解答如下：
一般的10pF左右的电容用来滤除高频的干扰信号,0.1uF左右的用来滤除低频的纹波干扰,还可以起...
PCB布线6大原则
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weixin_32025369
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- 2019-07-14 09:52
1 电源、地线的处理
既使在整个PCB板中的布线完成得都很好，但由于电源、
地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、 地线的布线要认真对待，把电、地线所产生的噪音干...
信号完整性问题最小化的100条通用设计原则
具有40年研究经验的国际大师Eric Bogatin给出的：100条使信号完整性问题最小化的通用
No.1 网络信号质量问题最小化
策略---保持信号在整个路径中感受到的瞬态阻抗不变。
设计原则：
1． 使用可控之阻抗布线。
2． 理想情况下，所有的...
PCB中的线宽
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qq_36449541
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- 2019-07-14 09:52
PCB
线宽与电流关系
这个问题一直很让我头痛，先把网上的资料整理一下，以后再修改补充。
我们需要知道铜箔厚度有0.5oz(约18μm)，1oz(约35μm)，2oz(约70μm)
铜，3oz(约105μm)及以上。
1.网上的表格
表格数据中所列出的承载值是在常...
The record for a starter making a printed circuit
大家好，欢迎来到我的博客。今天是第一次在实验室有着学长指导下制作PCB版，当然，自己还是新手，还有很多的需要做的、需要学的。这一次也是第一次开始在用CSDN记录的我实验室生活的一部分。话不多说，先把重点流程走一边，再把个人心得记...
Altium Designer设计适合打样的PCB
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xy03043126
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- 2019-07-14 09:52
1.设计规范
1.图层
2.尺寸及工艺
2.打样的技巧
1.拼板打样
2.价格核算
3.批量生产
【Linux】进程控制块PCB--task_struct结构体结构
Linux中task_struct用来控制管理进程，结构如下：
struct task_struct
{
//说明了该进程是否可以执行,还是可中断等信息
volatile long state;
//Flage 是进程号,在调用fork()时给出
unsigned long flags;
//进程上是否有待处...
PCB设计指南
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spacexplorer
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- 2019-07-14 09:51
高速PCB设计指南
高速PCB设计指南之一
第一篇 PCB布线
在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 ...
VCC、VDD、VDDA、VSS
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NarutoInspire
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- 2019-07-14 09:51
VDDA为所有的模拟电路部分供电，包括：
ADC模块，复位电路，PVD（可编程电压监测器），PLL，上电复位（POR）和掉电复位（PDR）模块，控制VBAT切换的开关等。即使不
使用ADC功能，也需要连接VDDA，强烈建议VDD和VDDA使用同一个电源供电。...
为什么PCB上的单端阻抗控制50欧姆
为什么PCB上的单端阻抗控制50欧姆
很多刚接触阻抗的人都会有这个疑问，为什么常见的板内单端走线都是默认要求按照50欧姆来管控而不是40欧姆或者60欧姆？这是一个看似简单但又不 好回答的问题。在写这篇文章前我们也查找了很多资料，其中...
PCB布局时去耦电容摆放经验分享
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edifier2009
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- 2019-07-14 09:51
PCB布局时去耦电容摆放经验分享
2017-02-22
对于电容的安装，首先要提到的就是安装距离。容值最小的电容，有最高的谐振频率，去耦半径最小，因此放在最靠近芯片的位置。容值稍大些的可以距离稍远，最外层放置容值最大的。但是，所有...
allegro 16.x 镜像整个模块的方法
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zhaopenglihui
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- 2019-07-14 09:51
方法一（allegro自带的功能）：mirror规则是走线会mirror到对应的层面，如TOP与bottom层对应，第三层与倒数第三层对应、、、以此类推 1.执行.Tools->Create Module···，右边find面板里勾选symbol、shape 、cline和via，框选要镜像的sym...