FPGA的普通I/O口用作时钟输入输出

2020-02-28 18:21发布

以前没用过FPGA,最近在用FPGA做数据采集,设计硬件的时候有个疑问,就是ALTERA的FPGA可以用普通I/O作为数据采集时钟的输入或输出脚使用吗,时钟频率为62MHZ,网上查了一下,有的说可以,有的说不行。
比较疑惑,有熟悉FPGA的兄弟可以解答一下吗?
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10条回答
阿多
1楼-- · 2020-02-29 08:03
Backkom80 发表于 2013-8-12 10:24
会有影响,有多大影响不好说,
时钟有抖动,偏移这些
恩,应该能用,62MHZ不是很高的时钟。 ...

谢谢版主
阿多
2楼-- · 2020-02-29 09:00
zbhbyc 发表于 2013-8-12 17:53
如果62MH是供给PLL用的,建议走专用的时钟输入口,其他的除了一写专用口外,其他的端口都可以做输出输入口
...

不是供给PLL用的,只是用作数据采集的同步时钟
王紫豪
3楼-- · 2020-02-29 11:36
 精彩回答 2  元偷偷看……
lwq030736
4楼-- · 2020-02-29 13:29
如果不是很多寄存器要用到这个时钟的话是没什么问题的

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