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• zhaojingzb 2020-02-25 05:54

modelsim 二分频出问题了

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• zhaojingzb 2020-02-25 04:42

ddr3 的app 接口仿真问题

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• zhaojingzb 2020-02-25 03:55

FPGA时钟问题，急急急！！加急急急！！

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• zhaojingzb 2020-02-25 02:14

关于isop补偿滤波器的系统函数表达

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• zhaojingzb 2020-02-25 00:44

FIFO输入数据48位。但是软核是32位的，怎么把他拆分成两个24

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• zhaojingzb 2020-02-24 23:27

3.3V ARM配置2.5V 的cyclon4有没有问题？

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• zhaojingzb 2020-02-24 23:06

FPGA时钟问题，急急急！！加急急急！！

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• zhaojingzb 2020-02-24 22:43

鍏充簬FPGA鐨処P鏍哥殑浣跨敤闂锛岃鏁欎笅

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• zhaojingzb 2020-02-24 22:39

V5使用ISERDES，MAP时出错

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• zhaojingzb 2020-02-24 21:37

ddr3 的app 接口仿真问题

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• zhaojingzb 2020-02-24 21:22

SPARTAN-6的clocking wizard输入用普通IO管脚怎么设置

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• zhaojingzb 2020-02-24 20:52

modelsim 二分频出问题了

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• zhaojingzb 2020-02-23 17:16

求助FPGA能否直接输出LVDS信号？

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• zhaojingzb 2020-02-23 16:04

3个if then 连续 执行顺序是怎么样的啊

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• zhaojingzb 2020-02-23 15:15

请教各位大神一个关于cyclone4上使用LVDS的问题，求解答~~~~